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本書介紹龍芯1B（LS1B）芯片的原理與應(yīng)用開發(fā)，以培養(yǎng)讀者的動手能力和增強(qiáng)讀者的工程素養(yǎng)為目標(biāo)，按照項目驅(qū)動的思路展開知識的講解和實踐操作。本書基于LS1B開發(fā)套件，講解LS1B的結(jié)構(gòu)及原理，還介紹進(jìn)行嵌入式系統(tǒng)開發(fā)需掌握的GPIO、UART等外設(shè)的基本原理與常用庫函數(shù)，以及國產(chǎn)物聯(lián)網(wǎng)操作系統(tǒng)RT-Thread的原理

《UGC質(zhì)量實時預(yù)判機(jī)制研究》融合用戶研究、行為科學(xué)、信息質(zhì)量、大數(shù)據(jù)分析等相關(guān)理論和方法，深入探討社交網(wǎng)絡(luò)用戶參與行為及其對UGC質(zhì)量的影響，通過挖掘“用戶行為-UGC質(zhì)量”關(guān)聯(lián)，把基于內(nèi)容和基于行為的方法結(jié)合起來，建立了多種基于用戶行為挖掘的UGC質(zhì)量實時預(yù)判模型，為UGC質(zhì)量治理提供新思路。 與之前相關(guān)研究相比

長時間以來人們在處理布爾網(wǎng)絡(luò)方面一直缺乏一個有效的分析和計算工具。自從2000年初程代展等人將半張量積引入到布爾網(wǎng)絡(luò)研究之后,人們對布爾網(wǎng)絡(luò)的認(rèn)識得到了有意義的深入和進(jìn)步。然而,布爾網(wǎng)絡(luò)理論還需要豐富和擴(kuò)展,有些問題還沒有得到有效解決,例如耦合布爾網(wǎng)絡(luò)的同步化問題。因為在現(xiàn)有的文獻(xiàn)中,關(guān)于帶外部輸入的主-從布爾網(wǎng)絡(luò)同步

本書從FPGA開發(fā)入門與芯片實際開發(fā)應(yīng)用角度出發(fā)，全面介紹了FPGA設(shè)計所需的理論基礎(chǔ)和工具應(yīng)用。書中針對VerilogHDL設(shè)計的基礎(chǔ)語法進(jìn)行了系統(tǒng)的介紹，對VerilogHDL中一些常接觸并容易出錯的概念進(jìn)行了詳細(xì)說明。同時，書中還介紹了在數(shù)字電路設(shè)計中常用的EDA工具、狀態(tài)機(jī)、仿真與測試方法。全書內(nèi)容介紹深入淺出

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