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本書幾乎涵蓋使用SystemVerilog在RTL層面對ASIC和FPGA進(jìn)行建模的所有方面，旨在為數(shù)字IC設(shè)計(jì)工程師提供全面的學(xué)習(xí)與參考資料。本書基于SystemVerilog-2017標(biāo)準(zhǔn)，首先闡述SystemVerilog與傳統(tǒng)Verilog的區(qū)別，以及其在仿真和綜合中的作用，并對RTL和門級建模等抽象級別進(jìn)行定

量子線路映射及優(yōu)化是量子算法部署到量子計(jì)算設(shè)備的關(guān)鍵環(huán)節(jié)。本書主要研究滿足量子計(jì)算設(shè)備物理約束的量子線路變換和映射問題。在給出量子線路映射的發(fā)展歷史和相關(guān)預(yù)備知識的基礎(chǔ)上，把研究內(nèi)容分為上下兩篇：上篇聚焦于量子線路邏輯變換，主要探討如何將可逆/量子線路轉(zhuǎn)換為滿足量子計(jì)算設(shè)備物理約束的低級量子線路，包括可逆/量子線路變換

本書依據(jù)IOI大綱編寫，旨在提供一份全面的現(xiàn)代算法競賽入門指南。本書介紹僅在論壇和博客文章中討論的算法競賽技巧，內(nèi)容包括遞歸算法和位運(yùn)算、時(shí)間復(fù)雜度、排序算法和二分查找、數(shù)據(jù)結(jié)構(gòu)、動(dòng)態(tài)規(guī)劃、圖論算法、算法設(shè)計(jì)專題、區(qū)間查詢、樹上算法、數(shù)學(xué)專題、高級圖算法、計(jì)算幾何、字符串算法、根號分治技術(shù)、動(dòng)態(tài)規(guī)劃優(yōu)化、回溯技術(shù)、如何

編譯系統(tǒng)是計(jì)算機(jī)系統(tǒng)中的系統(tǒng)軟件，是軟件開發(fā)環(huán)境的核心組成部分。本書介紹編譯系統(tǒng)的結(jié)構(gòu)、工作流程及編譯程序各組成部分的設(shè)計(jì)原理和實(shí)現(xiàn)技術(shù)。作者遵循CDIO工程教育理念將全書內(nèi)容分為四篇，第1篇構(gòu)思（Conceive），包括編譯程序概論、文法和語言；第2篇設(shè)計(jì)（Design），包括詞法分析、自頂向下語法分析、自底向上語法

本書從全可編程片上系統(tǒng)(APSoC)器件的概念和結(jié)構(gòu)特點(diǎn)入手，介紹典型APSoC器件——Zynq-7000系列高性能嵌入式芯片的體系結(jié)構(gòu)和片上資源，包括對其兩個(gè)主要組成部分[可編程邏輯(PL)部分和處理系統(tǒng)(PS)部分]的結(jié)構(gòu)，以及PL、PS兩部分協(xié)同設(shè)計(jì)為嵌入式系統(tǒng)設(shè)計(jì)帶來優(yōu)勢的詳細(xì)介紹。此外，本書分別詳細(xì)介紹PL、

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本書是C++語言版的數(shù)據(jù)結(jié)構(gòu)教材，在選材和編排上突出可讀性、實(shí)用性和應(yīng)用性，盡可能貼近當(dāng)前普通高等院校數(shù)據(jù)結(jié)構(gòu)課程的現(xiàn)狀和發(fā)展趨勢，符合最新研究生考試大綱。全書共9章，內(nèi)容包括緒論、線性表、棧和隊(duì)列、字符串和多維數(shù)組、樹與二叉樹、圖、查找、內(nèi)部排序、外部排序。書末附有二維碼，讀者可以通過掃描二維碼進(jìn)行學(xué)習(xí)參考。

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